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全自動・スケーラブルなSoC/ASICデザイン向けハイブリッド検証環境：HES-DVM
アルデック・ジャパン株式会社

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この製品について

■ハイブリッド検証プラットフォーム

・全自動・スケーラブルなSoC/ASICデザイン向けハイブリッド検証環境です。 ・SCE-MIやTLMなど最新の協調エミュレーション規格と最新のFPGAテクノロジを活かして、デザインのハードウェア・プロトタイプを早期に準備できるようになります。 ・RTL精度を持つ高抽象度のコードと高速化機能の高いSoCエミュレーション、モデルを開発、検証できるようになり、その結果テスト時間とシリコン・リスピンのリスクが削減できます。

■1プラットフォームで何通りものソリューション

・色々な応用ベルやシステムレベルのSoC/ASICデザイン検証を実行可能です。 ・TLMラッパーと高速AXI/AHBバス・トランザクタを活用する多くのアプリケーションでは、ハードウェア内に搭載されたデザインを仮想プラットフォームと接続することができるようになります。 ・FPGAで実行中のモジュール内部を100%可視化できるパワフルなデバッグ・ツールが付属し、HES-DVMエミュレーション・プラットフォームはRTLシミュレータと同じくらい使い勝手のよいツールです。

■スケーラビリティと再利用

1.スケーラビリティはHES-DVM™のプロジェクトのバックボーンとなる基本概念で、当社のソリューションの独自性の源泉です。 2.主な特徴 ・サポートするFPGAボード -アルデックのHESプロトタイピングボード -他社製、または社内開発のカスタムボード ・検証インタフェース ・デザインの自動セットアップ ・デバッギング機能

■フィジカルプロトタイピング

1.デザインの分割、クロック変換、およびFPGAへのマッピングを支援し、FPGAのI/Oの制限を克服するためにシリアル化手法を利用するチップ間接続の設計を容易にします。 2.主な特徴 ・サポートするFPGAボード -アルデックのHESプロトタイピングボード -他社製、または社内開発のカスタムボード ・自動デザインセットアップ ・スケーラビリティとリユース

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    全自動・スケーラブルなSoC/ASICデザイン向けハイブリッド検証環境：HES-DVM

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使用用途

#多画面表示 #解像度変換 #画質調整 #IP変換 #歪補正 #エッジブレンディング #画像回転 #モニター #低消費電力 #カメラ

実装技術

標準セルASIC ゲートアレイASIC 埋込メモリ付きASIC

遅延時間 ps

100 - 500 500 - 1,000 1,000 - 2,000 2,000 - 3,000 3,000 - 4,000

電源電圧 V

1 - 2 2 - 4 4 - 6 6 - 10 10 - 50

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アルデック・ジャパン株式会社

会社概要

アルデックは業界をリードするEDAツール・ベンダとして、革新的なデザイン作成、シミュレーション、検証ソリューションをリリースし、大規模FPGA/ASIC/SoCや組み込みシステム・デザインの開発に採用されています。

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  • 本社所在地: 東京都

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