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富士ソフト株式会社 インダストリービジネス事業部の対応状況 返信の比較的早い企業

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型番説明

■概要・特徴 LPDDR5/5XおよびLPDDR4/4Xデジタルコントローラは、モバイル、車載、IoT、エッジネットワーク機器などの低電力アプリケーション向けに高いメモリ帯域幅とスループットを実現します。 ■仕様 LPDDR5メモリ・コントローラの動作 LPDDR5コントローラコアは、シンプルなローカルインタフェースを使用してコマンドを受け付け、LPDDR5デバイスが必要とするコマンドシーケンスに変換します。また、コアはすべての初期化、リフレッシュ、パワーダウン機能を実行します。 コアはバンク管理ロジックを使用して、各LPDDRバンクのステータスを監視します。バンクは必要なときだけオープンまたはクローズされ、アクセス遅延を最小化します。コアは、コマンドキューに複数のコマンドをキューイングします。これにより、ランダム性の高いアドレス位置への短い転送と、連続したアドレス空間への長い転送の両方で、最適な帯域幅の利用が可能になります。 また、コマンドキューは、ルックアヘッド・アクティベート、プリチャージ、オートプリチャージの実行にも使用され、全体のスループットをさらに向上させます。 ■提供物 ・コントローラ (ソースコード) ・テストベンチ (ソースコード) ・完全ドキュメント

この製品について

■概要・特徴

Rambus Inc.のインターフェースIPは、Chip間およびProcesser (プロセッサ) とMemory (メモリ) 間の高速インターコネクトにより、膨大な量のデータを移動させ、高度なコンピューティング・アーキテクチャの目標性能を達成するための鍵となります。製品群として、インターコネクト・サブシステム IP、メモリインタフェース・サブシステムIP、ビデオ圧縮 & 前方誤り訂正IPがあります。

■仕様

PCIe®、CXL™、HBM、GDDR、DDR規格に対応したデジタルコントローラおよびPHY IPからなる完全なサブシステムソリューションを含む、最先端のインターコネクトおよびメモリインタフェースIPを提供します。また、LPDDRおよびMIPI®規格向けのデジタル・コントローラIPや、ビデオ圧縮および前方誤り訂正機能 (FEC:Forward Error Correction) IPのスイートも提供しています。高速 SerDes PHYは、高度なネットワーキング、5G、chip-to-chip (チップ間) 、die-to-die (ダイ間) のアプリケーションに対応しています。 ※他にも型番がございます。

  • 型番

    LPDDRメモリコントローラIP

企業レビュー 5.0

Metoree経由で見積もり

2024年2月7日にレビュー済み

顧客対応への満足度

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プロセッサとメモリ間の高速インターコネクト IPコア/インターフェース LPDDRメモリコントローラIPの性能表

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この商品の取り扱い会社情報

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会社概要

富士ソフト株式会社は1970年に設立した、ソフトウェア・システム開発を行う企業です。 リモートワークに活用可能な仮想オフィスツール、オフィスビルや商業施設などの電気・ガスなどのエネルギー使用量の分析・自動制御を行う管理...

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  • 本社所在地: 神奈川県
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